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Allegro PSpice System Option

Allegro PSpice System Option仿真技术

PSpice System Option软件模块将cadence仿真技术和MathWork 的Simulink-MATLAB仿真包整合在一起形成一个强大的联合仿真环境。

Simulink是一个多领域仿真和基于模型的动态系统仿真平台,与PSpice软件紧密集成,这允许设计人员执行系统级仿真,其中包括物理器件的实际电气模型,在早期的设计过程中也可以发现设计和集成问题,减少原型设计的迭代次数。集成还能够使机电系统的设计人员(如控制块,传感器和功率转换器)能够实现集成系统和电路仿真。(看图3)


图3:设计人员在Simulink-Allegro PSpice System Designer协同仿真后观察波形

功能特点

  •  整合电子电路、结构、液压以及热模块的联合仿真。
  • 系统中的电子设计模型内嵌物理的器件模型(考虑诸如非线性、延迟和其他真实的效应),使得系统仿真结果更精确。
  • 在系统级仿真环境下,Simulink能直接调用PSpice软件中带有的海量的器件模型、机械模型以及预定义的宏模型。
  • 在系统级仿真环境下,针对电路设计对系统的影响,设计师能直接对电路拓扑或者电路参数直接修改,并实时观测到其对系统的影响。
  • 充分利用MATLAB的分析和可视化数据,开发GUIs并创建模型数据和参数。

Checkpoint仿真重启

Checkpoint仿真重启功能允许设计人员在各个时间点存储仿真状态,然后从任何仿真状态重新开始仿真,从而节省时间。设计人员可以在从预先记录的时间状态开始仿真之前修改的仿真设置和设计参数。

自动收敛设置选项

此设置选项使仿真器能自动更改设计收敛的收敛容差极限,设计人员可以使用设置选项达到仿真收敛,然后通过进一步修改仿真器设置选项来微调仿真,这个设置选项在电力电子设计仿真上非常有用。

软件高级分析功能

使用高级分析功能,设计者能够自动最大化电路性能,这里有四大重要的分析功能:灵敏度分析、电路优化、应力分析和蒙特卡诺分析,这些分析使设计师能够创建设计的虚拟原型并自动最大化电路性能。软件也能对多个仿真剖面文件的测量一起处理。

灵敏度分析Sensitivity analysis

灵敏度分析是确定电路中哪个器件的参数是影响电路性能的关键。灵敏度分析可以检查电路设计中每个元件独立或与其它器件共同作用对电路性能影响程度的大小。通过灵敏度分析,设计师可以确定电路中的关键元件,使用优化工具优化器参数,从而优化电路性能。通过灵敏度分析也能发现那些器件对生产的影响最大,从而提高对他们的容差要求,降低对其他器件的容差要求,以达到降低成本,提高成品率的目的。

参数优化Optimizer

参数优化是通过对电路进行分析,比传统的实验室调试更方便快捷地达到提高电路性能的目的。参数优化可以帮助设计是最符合电路性能和规则要求的器件参数。设计师可以在参数优化工具中设定多个设计目标和规则,来对器件参数,设计目标进行通盘考虑。

设计师使用参数优化工具可以

  • 提高电路性能
  • 根据新的要求更新电路设计
  • 在自顶向下设计和模型创建中优化行为级模型
  • 参数优化工具中包括四个分析引擎
  • 最小二乘法搜索引擎
  • 改进的最小二乘法搜索引擎
  • 随机引擎
  • 分布引擎


OrCAD Signal Explorer

Cadence OrCAD Signal Explorer能帮助电子设计工程师们解决在电路板设计过程当中遇到的信号完整性问题,这些问题在原理图设计阶段到PCB元器件的布局和布线过程中一直存在。它可以进行布线前和布线 后的网络拓扑结构提取、信号仿真分析和验证,允许用户制定设计规则来驱动网络的互连方式来提高PCB设计的稳定性。

Cadence Allegro Design Authoring

系统厂商一直以来都在寻求以尽可能低的成本创新产品, 这迫切需要一种方法来创造性的产品设计---要求更短、更可预测的设计周期。随着新的标准接口、体系架构和实现方法等设计要求的不断加强,硬件设计师需要一个完整的设计输入解决方案来平衡不断发展的技术和方法的需要。Cadence Allegro Design Authoring是一种可扩展的、易用的设计解决方案,使用图表和电子表格界面来加快设计意图的实现过程(集成可驱动性的高速设计约束)。

Allegro Pspice Simulator

在较大的电路设计系统上,PCB设计团队需要快速、可靠的仿真软件来实现对设计的收敛Cadence Allegro PSpice®System Designer提供PCB设计人员的仿真技术是把电路仿真环境与PCB布局布线设计环境完全集成在一起,构成一个完整的统一集成环境设计师通过集成模拟和事件驱动数字仿真,可以在不牺牲精度的情况下提高仿真速度。同时,使用PSpice高级分析功能,设计师可以最大限度的提高电路的性能、提高成品率和可靠性

OrCAD PCB Designer

OrCAD PCB Designer提供了PCB从概念到生产所有环节所需要的设计解决方案,它具有灵活可扩展特点且经过产品设计验证,市场覆盖了从智能控制、工业机器人、汽车和航空航天等,OrCAD PCB Designer Standard和OrCAD PCB Designer Professional产品均可帮助客户在当今的电子市场保持一定的竞争力。OrCAD PCB 设计解决方案可以缩短设计周期,挑战新兴的软硬结合基板设计,可大大加快产品上市时间,实现设计目标。

Allegro PCB Design Solution

        随着半导体工业的发展,产生了越来越多的新型半导体器件,这也对设计带来了更大的技术挑战,比如器件引脚越来越多,而引脚间距越来越小,如BGA器件。此外,新型器件所应用的标准接口,如DDR3,DDR4,PCI Express Gen3,USB3.0等,需要采用新的方法进行电路设计。为了解决这些问题,PCB设计人员需要找到更好的解决方案来应对新技术带来的各种挑战。

Cadence OrCAD FPGA System Planner

      当工程师在PCB板上设计大规模引脚FPGA时,他们将遇到一些挑战:包括创建最初引脚分配、FPGA与原理图相结合、以及确保FPGA的合理布线。Cadence OrCAD FPGA System Planner正是为了应对如此的挑战,该模块为FPGA和PCB的协同设计提供了一个完整 的、并具有可扩展性的解决方案,它能使以创建最优“器件-规则-准确”为目标的引脚分配过程自动进行。使用自动引脚分配综合技术来 代替以前容易出错的手动操作过程,就可通过这个独特的布局解决方 案减少在PCB板设计过程当中出现的反复迭代次数,同时缩短了创建最优引脚分配所需要的时间。 

OrCAD PSpice Designer

OrCAD PSpice Designer是一款高性能的、经过工业级设计验证的数模混合电路仿真和波形查看仿真工具,作为全球最流行的、通用的、元器件和IC模型可扩展的混合电路仿真器,OrCAD PSpice软件仿真技术适用于许多行业领域的产品设计中,如航空航天、医疗、电力电子和汽车等行业,也广泛应用于一些研究机构作为设计参考实现来使用。它能够模拟你的设计从简单的电路,复杂的电路,功率电源系统到射频系统和定制的IC设计。内置数学函数,ABM行为建模,电路优化,机电系统联合仿真,其电路模拟仿真环境已经远远超过一般意义的电路仿真软件。

Cadence SiP Layout

      系统级封装(SiP)的实现为系统架构师和设计师带来了新的障碍。传统的EDA解决方案未能将高效的SiP发展所需的设计流程自动化。通过启动和集成设计理念的探索,捕捉,构建,优化,以及验证复杂的多芯片和PCB组件的分立基板,Cadence的SiP设计技术简化了多个高引脚数的芯片与单一基板间的集成。

OrCAD Sigrity ERC

Sigrity™ ERC(电气规则检查)拥有电气规则检查的功能,这能让电路板设计者在没有仿真模型或者足够的信号完整性专业能力的情况下, 简单而快捷地分析信号质量的问题和原因。
由于使用了工业和市场领先的Cadence Sigrity技术, Sigrity ERC超越了简单的基于几何的设计规则检查, 分析到那些通常只能被专业SI/PI工具发现的信号质量问题。


OrCAD PCB Productivity Toolbox

OrCAD PCB Productivity Toolbox提供了一套实用工具,旨在通过启用或简化当前常见或新兴的许多设计任务来提高PCB设计人员的工作效率,工具箱实用程序直接集成到OrCAD PCB编辑器环境中,也遵守其一贯的执行风格,对设计人员的工具使用习惯几乎没有影响。


Cadence OrCAD Capture原理图输入

Cadence OrCAD Capture是一款具有简单易用、功能特点丰富的电路原理图输入工具。由于它简单直观的使用模式和易用性使其成为全球最受欢迎的设计输入工具。同时具有元件信息管理系统(CIS)可以在线访问或从中心元件数据库中调用元器件符号,可以极大的提高电路图的绘制效率。

OrCAD Capture CIS

Orcad Capture CIS/ Allegro Design Entry CIS 16.6新增功能列表,如下,具体内容及相关操作见技术白皮书。

1.   在Capture下运行SigXplorer进行信号完整性分析

2.      从菜单中放置PSpice元件

3.      配置菜单和工具栏

4.      设计和库文件保存功能的扩展

5.      查找功能的扩展

6.      NetGroup使用模型的升级

7.      查询并替换Off-Page Connector(端口连接符)

8.      Cache更新扩展

9.      为元器件设置 User Assigned Flag.

10.        实现同一个设计中不同层次电路图的自动顺序编号

11.        数据库压缩与处理能力的增强

12.        打开由低版本软件生成的设计文件

13.        关闭所有标签页

14.        DRC功能扩展

15.        Project SaveAs功能的扩展

16.        学习资料

II. Capture 16.6中已经解决的重要问题

1、CCR 1065649: 兼容16.5和16.3版本问题

2、CCR 730224:对库文件进行了更新但没有更新信息

3、CCR 724738:Update/Replace Cache对用户定义的引脚形状无效

序号 文件名称 文件大小 上传时间
1    2020-04-01
2   OrCAD PCB Designer-U-Creative.pdf 1.04MB 2020-03-20
3   Cadence OrCAD FPGA System Planner.pdf 6.83MB 2020-03-25
4   Allegro_PCB_Design.pdf 2.67MB 2020-03-20
5   OrCAD PCB Designer-U-Creative.pdf 1.04MB 2020-03-20
6   Allegro Pspice Simulator.pdf 8.94MB 2020-03-20
7   Cadence Allegro Design Authoring.pdf 7.37MB 2020-03-19
8   OrCAD Signal Explorer.pdf 4.89MB 2020-03-18
9   orcad-productivity-toolbox-U-Creative.pdf 5.31MB 2020-03-14
10   OrCAD Sigrity ERC 404 KB 2011-09-07
11   Cadence PCB Designer_datasheet.pdf 904 KB 2010-11-18
12   Cadence OrCAD Capture原理图输入.pdf 849 KB 2010-11-18